的分析得出，读写时差的最低点总是发生在一帧末尾，而在帧首通过两脉冲相位差就能判断本帧是否需要码速调整。具体地说，P1和P2输入进行鉴相判决得到帧首的读写时差T0，与调整门限值TS进行比较，若T0gtTS则本帧不需要调整，反之若T0leTS，则需要调整。这时模块输出反馈信号F
给缓存器，和调整控制负脉冲Gate给输入码控制电路模块。4插入码控制电路模块该模块的功能是对缓存器的读出信息进行插入码控制，输出2112MHz的非均匀时钟clk_rd和参与合路的支路码流。为了标志是否在时隙SZ有插入调整比特，就必须引入插入
f标志码。通常在一帧中规定一个特定时隙SV，提供一次码速调整的机会。如果某支路需要进行调整，就在该时隙插入一比特脉冲，如不需要调整则该时隙仍传支路信息。为确保可靠性，通常采用3位码作为插入标志码。如果某支路有插入调整，用标志码为111来表示，否则用000表示。5帧定位信号发生器模块该模块产生帧同步信号和告警指示码，帧定位信号可以集中插入，也可以分散到各支路插入，考虑到设备和延迟问题，我们选择集中插入。6合路器模块根据每个时间间隔传送码字的多少，有3种排列方式：按位复接、按字复接和按帧复接。其中按位复接要求缓存器容量较小，较易实现，而且二次群帧结构是由4个支路子帧按位复接而成，所以一般采用按位复接，本文采用的也是该方式。该模块按位顺序循环读取四路码速调整后的码流，在对应SF时隙插入帧定位信号ldquo111101000000rdquo，得到二次群信号，即完成整个复接部分。分接电路设计分接过程，它是由帧定位捕获电路、同步时钟提取电路、分路器、分接时序信号发生器、插入码扣除控制电路、时钟平滑电路和码速恢复控制电路7个模块构成。由于四路分接电路基本相同，所以略去其余三路电路。1帧定位捕获电路模块该模块通过捕获帧定位信号分辨帧首位置，并判定系统的状态。当连续3次捕获到帧定位信号，则判定系统处于同步态之后若连续4次没捕获到帧定位信号，则判定系统进入失步态，并关闭分接时序信号发生器，也不再接收数据一旦捕获到帧定位信号，便驱动分接时序信号发生器工作，并开始接收数据。这里要求模块在系统失步后能重新进入同步，如果传输中帧同步码组连续丢失了几帧，而系统又没有自恢复能力，那么整个系统将无法再正常工作。2同步时钟提取模块数据流的接收需要与之速率相同的时钟，这就需要对二次群码流进行位同步时钟提取，得到与之速率一致的均匀时钟给分r