摘要
数字时钟就是以数字显示取代模拟表盘的钟表在显示上它用数字反应此时的时间它还能同时显示时分秒且能够对时分秒准确进行校时。
数字时钟是一种用数字电路技术实现时、分、秒计时的装置。与机械式时钟相比具有更高的准确性和直观性且无机械装置具有更长的使用寿命已得到广泛的使用。数字钟从原理上讲是一种典型的数字电路一般是由振荡器、分频器、计数器、显示器等几部分组成。其中包括了组合逻辑电路和时序电路。数字钟的设计方法有许多种例如可用中小规模集成电路组成电子钟也可以利用专用的电子钟芯片配以显示电路及其所需要的外围电路组成电子钟还可以利用单片机来实现电子钟等等。
本设计采用EDA技术以硬件描述语言VerilogHDL为系统逻辑描述手段设计文件在QUARTUSII工具软件环境下采用自顶向下的设计方法由各个基本模块共同构建了一个基于FPGA的数字钟。
数字时钟以其体积小、重量轻、抗干扰能力强、对环境要求高、高精确性、容易开发等特性在工业控制系统、智能化器仪表、办公自动化等诸多领域取得了极为广泛的应用诸如定时自动报警、按时自动打铃、时间程序自动控制、定时广播、自动启闭路灯、定时开关烘箱、通断动力设备、甚至各种定时电气的自动启用等。
关键词EDA、QuartusII、VerilogHDL、FPGA芯片、数字时钟等
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