DSPCPLD和单片机高速数据采集装置设计研究分析摘要：数据采集的速度不断的需要提高，为了满足对频率和分辨率技术上的要求，利用dsp、cpld及单片机技术构建一种高速采集装置。下面就以这些电器元件为核心设计了一个高速信息采集装置。关键词：dsp；cpld；分组处理；系统构成；usb选择中图分类号：tp2742文献标识码：a文章编号：10079599201124000001dspcplda
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一、dsp、cpld及单机片数据采集装置的组成目前电子技术不断发展，人们对自动化数据处理与采集的频率
f和分辨率都提出了更加严格的要求，因此高速度的数据采集装置就成为了需求的热点。而在dsp、cpld以及单片机的帮助下可以设计构成高速数据采集装置，并为实际应用服务。其组成如下：
系统首先对电压和电流的模拟信号进行调整，分别利用2个ad芯片进行数据转换成为数字信号，然后传输至复杂可编程逻辑元件，即cpld，同时利用2个ram完成采集数据的存储。在cpld上编辑程序控制时序，然后ram完成读写。系统中dsp即数字处理芯片输出原始信号，并通过cpld完成对ram数据的读取，此数据为采样数据，最后传输到单片机上，利用单片机的接口完成向控制计算机的数据传输，同时单片机还具有引导和装载程序的功能。
二、高速数据采集装置的芯片组成与功能实现（一）双通道adc高速芯片选择高速ad转换芯片是系统产生合理时序的重要基础，采用的芯片最好具备两种输出模式，如ltc2299，一种是复用、一种是非复用。采用复用模式的时候时序与采用非复用模式的时序不同。在设计的时候如果突出其高速采集性质，为了节约cpld的端口，选择采用的是复用模式对时序进行控制，此时序为cpld生成。（二）异步ram的选用数据处理中ram的选择突出其高速性能，选择高速性能推出的静态ram可以实现系统的高速性需求。在设计中将采用的ram分为两组，如is61lv51216。分别对电压和电流进行采集，每组由4个芯片组成，控制的存储深度可达4m×16bit。在采集装置中芯片的
f读写时序也是以cpld生成。（三）可编程逻辑器的选择系统选择了ispmachlc4256v芯片r