设运算放大器为理想器件，所以UN≈UP。又因为：UP（R2R1R2）U02，UNU0（R3R3R4）×5
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f所以，输出电压满足关系式U0U02（R2R1R2）（R3R3R4）×5令R1R40，R2R31KΩ。则U0U025。
4译码显示电路
译码显示电路图
5输入直流电源产生电路（整流滤波电路）首先确定整流电路结构为桥式电路；滤波选用电容滤波。电路如下图所示。
整流滤波电路图
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f33确定元件型号，写明详细的元件参数，列出元件明细表1元件74LS19274LS192的清除端是异步的。当清除端（MR）为高电平时，不管时钟端（CPd、CPu）状态如何，即可完成清除功能。74LS192的预置是异步的。当置入控制端（TL）为低电平时，不管时钟CP的状态如何，输出端（QOQ3）即可预置成与数据输入端（POP3）相一致的状态。74LS192的计数是同步的，靠CPd、CPu同时加在4个触发器上而实现。在CPd、CPu上升沿作用下QOQ3同时变化，从而消除了异步计数器中出现的计数尖峰。当进行加计数或减计数时可分别利用CPd或CPu，此时另一个时钟应为高电平。当计数上溢出时，进位输出端（TCU）输出一个低电平脉冲，其宽度为CPu低电平部分的低电平脉冲；当计数下溢出时，错位输出端（TCD）输出一个低电平脉冲，其宽度为CPd低电平部分的低电平脉冲。当把了Cd和了Cu分别连接后一级的CPd、CPu，即可进行级联。逻辑图如图所示。
74LS192逻辑图
引出端符号见表所示。
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fTC
DU
错位输出端（低电平有效）进位输出端（低电平有效）减计数时钟输入端（上升沿有效）加计数时钟输入端（上升沿有效）异步清除端并行数据输入端异步并行置入控制端（低电平有效）
74LS192引出端符号
TC
CPdCPuMRP0～P3
PL
2元件CW78057805系列为3端正稳压电路TO220封装，能提供多种固定的输出电压，应用范围广。内含过流、过热和过载保护电路。带散热片时，输出电流可达1A。虽然是固定稳压电路，但使用外接元件，可获得不同的电压和电流。
7805外形图及引脚图
3元件LM324
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fLM324管脚图
LM324系列运算放大器是价格便宜的带差动输入功能的四运算放大器。可工作在单电源下，电压范围是30V32V或16V4和11管脚分别接15V和15V4元件SN74123
SN74123引脚图（管脚图）：
引出端符号：CEXT1、CEXT2外接电容端Q1、Q2正脉冲输出端Q1、Q2负脉冲输出端CLR1、CLR2直接清除端（低电平有效）A1、A2负触发输入端B1、B2正触发输入端
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f5元件清单
相关芯片、元器件74LS192SN74123LM324CW78051N4001100K电位器10K电位器按键降压变压器220v20v数码显示管电阻、电容
主要用途十进制可逆r